论文编号:ZD235 论文字数:10427,页数:33
摘 要
提出了一种基于CPLD的全数字高频脉宽调制器的实现电路，并对电路的工作原理和工作过程进行了详细的叙述，给出了实验波形和实验数据。本实验运用了Verilog HDL语言，Verilog HDL就是在用用最广泛的C语言的基础上发展起来的一种件描述语言实验结果证明了这种电路的实用性和正确性。
关键词： 调制器/同步信号；数字脉宽调制器 Verilog 可编程器件
According to the CPLD SPWM a form takes place the design of the machine
Abstract
Put forward a kind of high fervency in word in total amount vein breadth that base on the CPLD make the machine realizes electric circuit, and to the work principle of the electric circuit with work the process proceeded the detailed description, giving the experiment a form with the experiment data. This experiment made use of the language of Virile HDL, the Virile HDL is in phonetic foundation in the most extensive C that with a kind of a function for describing language experiment result proof this kind of electric circuit to develop with the accuracy.
Key words: Make the machine/ synchronous signal; The arithmetic figure vein breadth makes programmable machine in Virile in machine piece
目 录
摘要…………………………………………………………………………………………Ⅰ
Abstract……………………………………………………………………………………Ⅱ
任务书
绪论…………………………………………………………………………………………1
第一章 引言………………………………………………………………………………1
1.1 SPWM技术的应用……………………………………………………………………1
1.2 设计思路……………………………………………………………………………2
第二章 工作原理…………………………………………………………………………3
2.1 基本组成……………………………………………………………………………3
2.2 工作过程……………………………………………………………………………3
第三章 设计原理…………………………………………………………………………5
3.1 系统原理…………………………………………………………………………5
3.1.1CPLD内部设计…………………………………………………………………5
3.1.2SPWM波形生成原理……………………………………………………………9
3.2系统逻辑设计……………………………………………………………………9
3.2.1系统总线接口单元…………………………………………………………………9
3.2.2过流、欠压、IPM保护逻辑…………………………………………………9
3.2.3三角载波产生…………………………………………………………………9
3.2.4正弦调制波的产生……………………………………………………………9
3.2.5正弦调制波幅值的调节………………………………………………………10
3.2.6三相正弦信号的产生…………………………………………………………10
3.2.7不对称控制设计………………………………………………………………11
3.2.8系统逻辑与时序功能仿真……………………………………………………11
第四章 选用的 PLD………………………………………………………………………15
4.1 PLD/FPGA 结构与原理初步…………………………………………………………15
4.1.1基于乘积项（Product-Term）的PLD结构…………………………………………15
4.1.2 乘积项结构PLD的逻辑实现原理…………………………………………………17
第五章：设计程序…………………………………………………………………………19
5.1 语言……………………………………………………………………………………19
ＣＰＬＤ各模块的设计……………………………………………………………19
5.2.1 控制寄存器的设计…………………………………………………………………19
5.2.2 分频比可变的分频器模块设计……………………………………………………21
5.2.3寻址计数器设计……………………………………………………………………22
5.2.4 模３６０加法器设计………………………………………………………………23
5.2.5 查找表ＲＯＭ设计…………………………………………………………………24
5.3 实现程序………………………………………………………………………………25
结论………………………………………………………………………………26
致谢…………………………………………………………………………………………27
参考文献………………………………………………………………………………… 28
